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W7500
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W7500

& 为IOP(网络卸载处理器)单芯片解决方案 & 集成ARM Cortex-M0,128KB Flash & 全硬件TCP/IP核
W7500 是一款单芯片的网络卸载处理器(IOP)。它不仅内嵌128KB Flash的ARM Coretex-M0内核,还包含了全硬件TCP/IP协议栈内核。从而,适用于各类嵌入式应用平台。特别是在物联网领域。

其集成了以太网MAC的TCP/IP 协议栈内核,支持TCP, UDP, IPv4, ICMP, ARP, IGMP 以及 PPPoE协议,久经市场考验,并得到广泛认可。W7500特别适用于应用中需要网络连接的用户。



特点


ARM Cortex-M0
  • 最大时钟频率 48MHz

全硬件TCP/IP核
  • 8个socket
  • 每个socket拥有最大32KBSRAM
  • MII(介质无关接口)

内存
  • Flash:128KB
  • SRAM:16KB到48KB(如32KB socket 缓存已用,最小可用16KB,如果socket缓存未用,最大可用48KB)
  • 用于Boot程序存储的ROM:6KB

时钟,复位及供给管理
  • POR(上电复位)
  • 稳压器:3.3V到1.5V
  • 8到24MHz的外部晶体振荡器
  • 内部内部8MHz的阻容振荡器
  • 用于CPU时钟的锁相环

ADC
  • 12bit,8ch,1Msps


DMA

  • 6路DMA 控制器
  • 外设: UARTs, SPIs


GPIO

  • 53 I/Os (16 IO x 3ea, 5 IO x 1ea)


调试方式

  • 串行调试 (SWD)


定时器/PWM

  • 看门狗*1 (32位减法计数器)
  • 计时器*4 (32位或16位减法计数器)
  • PWM*8 (带有6位可编程预分频器的32计数器/定时器)


通讯接口

  • 3 UART (2个带有FIFO及流控的 UART, 1 个单UART)
  • 2 SPI
  • 2 I2C (主/从, Fast-mode (400 kbps))


加密

  • 1 RNG (随机数生成器): 32位随机码


封装 : 64 TQFP (7×7 mm)



方框图

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